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发表于 2015-6-2 10:07 | 显示全部楼层
再加一个fpga或CPLD 做异步数据处理合成I2S,不要使用ARM本身的I2S,能极大的降低ARM本身带来的jitter,降低jitter的关键是降低LRCK这个时钟的jitter,不大喜欢PLL,也是个闭环的东西,多一个环路多一个鬼

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 楼主| 发表于 2015-6-2 21:16 | 显示全部楼层
cdream 发表于 2015-6-2 10:07
再加一个fpga或CPLD 做异步数据处理合成I2S,不要使用ARM本身的I2S,能极大的降低ARM本身带来的jitter,降 ...

请教一下,不是很懂。
是否采用 FPGA 或 CPLD,就可以消除 jitter?在这种情况下,只剩下了晶振的 jitter?还是连晶振的 jitter 都可以降低或消除?

FPGA 和 CPLD 是否自身会引进 jitter?

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发表于 2015-6-2 22:55 | 显示全部楼层
jialong0926 发表于 2015-6-2 21:16
请教一下,不是很懂。
是否采用 FPGA 或 CPLD,就可以消除 jitter?在这种情况下,只剩下了晶振的 jitte ...

消除是不可能的,是尽可能降低,异步的好处就是,影响jitter的因数只变成了CPLD和晶振,相对ARM, CPLD和晶振的jitter相对容易,这是为什么很多高端的器材都要用到异步FIFO,或者说现在流行的PC播放喜欢用ASIO;换个角度说,让ARM去处理存储设备数据读取,文件操作,人机界面(光处理这些引起的干扰就可以造成很大的抖动了),让CPLD配合晶振来合成I2S,任务越小抖动越小,各司其职

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 楼主| 发表于 2015-6-2 23:50 | 显示全部楼层
cdream 发表于 2015-6-2 22:55
消除是不可能的,是尽可能降低,异步的好处就是,影响jitter的因数只变成了CPLD和晶振,相对ARM, CPLD和 ...


一直理解得不是很透。

是 LRCK 的 jitter 影响大,还是 MCLK 的 jitter 影响大?

还是两者都有影响?
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发表于 2015-6-3 08:36 | 显示全部楼层
jialong0926 发表于 2015-6-2 23:50
一直理解得不是很透。

是 LRCK 的 jitter 影响大,还是 MCLK 的 jitter 影响大?

LRCK是关键,DAC 数字到模拟信号的转换, 就是靠LRCK(边沿)来触发,所以LRCK抖动如何,模拟信号就会抖动如何;

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发表于 2015-6-3 15:15 来自手机端 | 显示全部楼层
cdream 发表于 2015-6-3 08:36
LRCK是关键,DAC 数字到模拟信号的转换, 就是靠LRCK(边沿)来触发,所以LRCK抖动如何,模拟信号就会抖 ...

反对,LRCK重要的功能是逻辑锁定,变化时,将数据锁定并呈现在DAT引脚上。大多数的DAC是靠MCK作为转换时钟的。也有一些DAC是靠BCK为转换时钟,那就没有MCK了。

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 楼主| 发表于 2015-6-3 21:44 | 显示全部楼层
musich 发表于 2015-6-3 15:15
反对,LRCK重要的功能是逻辑锁定,变化时,将数据锁定并呈现在DAT引脚上。大多数的DAC是靠MCK作为转换时 ...

我自己也有这个感觉,就是 MCLK 如果有不同步的情况时,甚至会出现相当大的噪音。

MCLK 似乎是用于过采样,是不是可以理解为,LRCK 只是用于锁定数据,而真正进行 DAC 转换,是由 MCLK 触发的?

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 楼主| 发表于 2015-6-3 21:45 | 显示全部楼层
如果是这样的,那么似乎 MCLK 对音质的影响更大些,而 LRCLK 已经变为纯数字领域的事情了?

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发表于 2015-6-3 23:57 | 显示全部楼层
jialong0926 发表于 2015-6-3 21:45
如果是这样的,那么似乎 MCLK 对音质的影响更大些,而 LRCLK 已经变为纯数字领域的事情了?

音质要好,MCLK,BCLK,LRCK,data都必须严格同步
由晶振提供MCLK,再通过分频电路得到BCLK和LRCK,这样出来的jitter就只受晶振本身和分频电路影响。

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发表于 2015-6-4 01:04 | 显示全部楼层
MCK,BCK,LRCK,DAT,  这几个信号不是独立的,要保持严格的相位关系,
比如常用的256倍超取样:
MCK = 256LRCK,
BCK = 64LRCK,这个恒成立,只要是I2S,就必满足,  
对于512倍的 则是MCK = 512LRCK, 512fs,
因此不能说哪一个引起抖动,

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 楼主| 发表于 2015-6-4 08:03 来自手机端 | 显示全部楼层
haluo 发表于 2015-6-3 23:57
音质要好,MCLK,BCLK,LRCK,data都必须严格同步
由晶振提供MCLK,再通过分频电路得到BCLK和LRCK,这样 ...

是的,这几个严格同步是基本要求。
我只是想更多的了解,是mclk影响大,还是lrck影响大?
在确定最大的影响因素后,可以采用最有效的手段降低这种影响。

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 楼主| 发表于 2015-6-13 14:07 来自手机端 | 显示全部楼层
最近一直在优化硬件和软件。有人联系说期望把这个做成产品。个人觉得从性价比的角度而言,这个方案具有较大的竞争力。商品化不知是否合适?

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 楼主| 发表于 2015-6-13 14:14 来自手机端 | 显示全部楼层
此外,同时在做另一个双晶振方案,由22.5792MHz和24.576MHz晶振直接做 I2S 的 MCLK,简单进行了原理实验,目前已经在做 PCB 打样。打样到后将进行软件开发和测试。期待这个新的方案能够有更好的音质呈现。

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 楼主| 发表于 2015-6-13 14:21 来自手机端 | 显示全部楼层
新的双晶振方案仍然采用纯单片机,测试仍然先用 CS4398,后续测试一下 AK4399。单片机换成了  STM32F405,管脚少了,但够用,可以兼容 205、103。

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发表于 2015-7-2 14:41 来自手机端 | 显示全部楼层
jialong0926 发表于 2015-6-13 14:07
最近一直在优化硬件和软件。有人联系说期望把这个做成产品。个人觉得从性价比的角度而言,这个方案具有较大 ...

这个支持,到时候买部,,
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